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うだうだ日記 2001年 3月28日2001年3月28日 水曜日
初めて自分で考えた回路のVHDL記述を書く。 Meadow(Emacs)もVHDLモードでいろいろ手伝ってくれる。 ^_^; Flip-Flop 2個の簡単なもの。 XilinxのWebPackでシミュレーションできた。 HDL Bencherというツールで入力パタンをGUIで作れるのが 気持ち良いが、すぐに容量制限を超えてしまった。 登録すれば無料でもっとでかいパタンを作れるよ、と出るが 登録サイトに接続できない。昨年12月に製造元がXilinxに 買収されたらしいので、変更があったのかもしれない。 昔は どうやって入力パタンを作っていたかと考えると テキストエディタで0/1を書いてましたね。 VHDLでも同じことができるはず。明日挑戦しよう。
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